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CY28326OCT 参数 Datasheet PDF下载

CY28326OCT图片预览
型号: CY28326OCT
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内容描述: FTG威盛PT880芯片组的串行 [FTG for VIA PT880 Serial Chipset]
分类和应用: 晶体外围集成电路光电二极管时钟
文件页数/大小: 22 页 / 224 K
品牌: SPECTRALINEAR [ SPECTRALINEAR INC ]
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CY28326
字节7 : FRACT定位仪控制寄存器
(续)
6
5
4
3
2
1
0
@Pup
0
0
0
1
0
0
0
名称/引脚受影响
考位
考位
版权所有
版权所有
版权所有
Fract_Align1
Fract_Align0
请不要更改,默认值= 0
请不要更改,默认值= 0
版权所有
版权所有
版权所有
AGP和PCI固定频率选择位1
AGP和PCI固定频率。此选项不包含蔓延
频谱。它是通过Fixed_AGP_SEL位使能( B8b7 )
Fract_align1
0
0
1
1
Fract_align1
0
1
0
1
AGP
66.6
75.0
75.0
85.7
PCI
33.3
37.5
37.5
42.8
描述
字节8 :控制寄存器
7
@Pup
0
名称/引脚受影响
AGP
描述
AGP输出频率选择模式。选择频率源为AGP
输出。
0 =根据频率选择表设置
1 =根据分数定位仪设置程序FRACT定位仪套装
设置此位之前的值。
版权所有
Recovery_Frequency
该位允许选择的频率设定,时钟会
恢复一次系统重新启动。
0 =使用的硬件设置, 1 =使用最后SW表中设置的值。
该位被置为“1”时,看门狗超时。它被复位为“0”时
该系统清除WD_TIMER时间戳。
看门狗定时器时间戳记的选择:
0000 :关闭
0001 : 10毫秒
0010 : 4秒
.
.
.
6
5
1
0
4
3
2
1
0
0
0
0
0
0
WD_Alarm
WD_TIMER3
WD_TIMER2
WD_TIMER1
WD_TIMER0
1110 : 28秒
1111 :30秒
字节9 :控制寄存器
7
6
5
4
3
2
1
0
@Pup
0
0
0
0
0
0
0
0
名称/引脚受影响
CPU_FSEL_N7
CPU_FSEL_N6
CPU_FSEL_N5
CPU_FSEL_N4
CPU_FSEL_N3
CPU_FSEL_N2
CPU_FSEL_N1
CPU_FSEL_N0
描述
如果打电话问频使能位被置位,值编程
CPU_FSEL_N [ 8:0]和CPU_FSEL_M [6:0 ]将被用来确定
CPU的输出频率。
在FS_Override位这个设置决定了频率比CPU
和其它输出时钟。当它被清除,同样的频率比
寄存器将用于:在锁定FS [ A D ]表示。当它被置位,则
频率比表示在SEL [ 3:0]寄存器将被使用。
1.0版, 2006年11月20日
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