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CY28326OCT 参数 Datasheet PDF下载

CY28326OCT图片预览
型号: CY28326OCT
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内容描述: FTG威盛PT880芯片组的串行 [FTG for VIA PT880 Serial Chipset]
分类和应用: 晶体外围集成电路光电二极管时钟
文件页数/大小: 22 页 / 224 K
品牌: SPECTRALINEAR [ SPECTRALINEAR INC ]
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CY28326
字节10 :控制寄存器
7
6
5
4
3
2
1
0
@Pup
0
0
0
0
0
0
0
0
名称/引脚受影响
CPU_FSEL_N8
CPU_FSEL_M6
CPU_FSEL_M5
CPU_FSEL_M4
CPU_FSEL_M3
CPU_FSEL_M2
CPU_FSEL_M1
CPU_FSEL_M0
描述
拨号-A-频率使能位被置位,则值编程
CPU_FSEL_N [ 8:0]和CPU_FSEL_M [6:0 ]将被用来确定
CPU的输出频率。
在FS_Override位这个设置决定了频率比CPU
和其它输出时钟。当它被清除,同样的频率比
寄存器将用于:在锁定FS [ A D ]表示。当它被置位,则
频率比表示在SEL [ 3:0]寄存器将被使用。
字节11 :控制寄存器
7
6
@Pup
0
0
名称/引脚受影响
Dial_A_Frequency
启用
描述
拨号-A-频率输出频率启用
0 =禁用, 1 =启用
WD定时器重载&重置要启用此功能寄存器位必须先被置为“0”
之前切换到“1”的
0 =不重新加载, 1 =复位定时器,但继续计数。
考位
考位
考位
考位
24-48 M_SEL
请不要更改,默认值= 1
请不要更改,默认值= 0
请不要更改,默认值= 0
请不要更改,默认值= 0
“0” = 48兆赫, “1”= 24兆赫,缺省值= “ 0”时,电平可以是BIOS的期间变化
只有启动。系统会挂起,如果这个配置系统后更改
靴子。
请不要更改,默认值= 1
5
4
3
2
1
1
0
0
0
HW
0
1
考位
1.0版, 2006年11月20日
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