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GAL26CV12C-7LJ 参数 Datasheet PDF下载

GAL26CV12C-7LJ图片预览
型号: GAL26CV12C-7LJ
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内容描述: 高性能E2CMOS PLD通用阵列逻辑 [High Performance E2CMOS PLD Generic Array Logic]
分类和应用: 可编程逻辑器件输入元件时钟
文件页数/大小: 17 页 / 256 K
品牌: LATTICE [ LATTICE SEMICONDUCTOR ]
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Specifications
GAL26CV12
GAL26CV12 Logic Diagram/JEDEC Fuse Map
DIP & PLCC Package Pinouts
1
0
4
8
12
16
20
24
28
32
36
40
44
48
0000
0052
.
.
.
0468
ASYNCHRONOUS RESET
(TO ALL REGISTERS)
28
8
OLMC
S0
6344
S1
6345
27
2
0520
.
.
.
0936
8
OLMC
S0
6346
S1
6347
26
3
0988
.
.
.
1404
8
OLMC
S0
6348
S1
6349
25
4
1456
.
.
.
1872
8
OLMC
S0
6350
S1
6351
24
5
1924
.
.
.
.
2444
10
OLMC
S0
6352
S1
6353
23
6
2496
.
.
.
.
.
3120
12
OLMC
S0
6354
S1
6355
22
8
3172
.
.
.
.
.
3796
12
OLMC
S0
6356
S1
6357
20
9
3848
.
.
.
.
4368
10
OLMC
S0
6358
S1
6359
19
10
4420
.
.
.
4836
8
OLMC
S0
6360
S1
6361
18
11
4888
.
.
.
5304
8
OLMC
S0
6362
S1
6363
17
12
5356
.
.
.
5772
8
OLMC
S0
6364
S1
6365
16
13
5824
.
.
.
6240
8
OLMC
S0
6366
S1
6367
15
14
6292
SYNCHRONOUS PRESET
(TO ALL REGISTERS)
6368, 6369 ...
M
S
B
L
S
B
Electronic Signature
... 6430, 6431
Byte 7 Byte 6 Byte 5 Byte 4 Byte 3 Byte 2 Byte 1 Byte 0
5