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    N25Q128A11B1241F 参数 Datasheet PDF下载

    N25Q128A11B1241F图片预览
    型号： N25Q128A11B1241F
    PDF下载： 下载PDF文件 查看货源
    内容描述： 128兆位， 1.8 V ，多个I / O ， 4 KB的界别分组擦除引导扇区， XIP启用，串行闪存与108 MHz的SPI总线接口 [128-Mbit, 1.8 V, multiple I/O, 4-Kbyte subsector erase on boot sectors, XiP enabled, serial flash memory with 108 MHz SPI bus interface]
    分类和应用： 闪存
    文件页数/大小： 185 页 / 5874 K
    品牌： MICRON [ MICRON TECHNOLOGY ]
     浏览型号N25Q128A11B1241F的Datasheet PDF文件第5页浏览型号N25Q128A11B1241F的Datasheet PDF文件第6页浏览型号N25Q128A11B1241F的Datasheet PDF文件第7页浏览型号N25Q128A11B1241F的Datasheet PDF文件第8页浏览型号N25Q128A11B1241F的Datasheet PDF文件第10页浏览型号N25Q128A11B1241F的Datasheet PDF文件第11页浏览型号N25Q128A11B1241F的Datasheet PDF文件第12页浏览型号N25Q128A11B1241F的Datasheet PDF文件第13页  
    N25Q128 - 1.8 V
    List of figures
    List of figures
    Figure 1.
    Figure 2.
    Figure 3.
    Figure 4.
    Figure 5.
    Figure 6.
    Figure 7.
    Figure 8.
    Figure 9.
    Figure 10.
    Figure 11.
    Figure 12.
    Figure 13.
    Figure 14.
    Figure 15.
    Figure 16.
    Figure 17.
    Figure 18.
    Figure 19.
    Figure 20.
    Figure 21.
    Figure 22.
    Figure 23.
    Figure 24.
    Figure 25.
    Figure 26.
    Figure 27.
    Figure 28.
    Figure 29.
    Figure 30.
    Figure 31.
    Figure 32.
    Figure 33.
    Figure 34.
    Figure 35.
    Figure 36.
    Figure 37.
    Figure 38.
    Figure 39.
    Figure 40.
    Figure 41.
    Figure 42.
    Figure 43.
    Figure 44.
    Figure 45.
    Figure 46.
    Figure 47.
    Figure 48.
    Logic diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13
    VDFPN8 connections . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
    SO16 connections . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
    BGA connections . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
    Bus master and memory devices on the SPI bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
    Extended SPI protocol example . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
    Hold condition activation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
    Non Volatile and Volatile configuration Register Scheme . . . . . . . . . . . . . . . . . . . . . . . . . 33
    Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52
    Read identification instruction and data-out sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80
    Read Data Bytes instruction and data-out sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81
    Read Data Bytes at Higher Speed instruction and data-out sequence . . . . . . . . . . . . . . . 82
    Dual Output Fast Read instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
    Dual I/O Fast Read instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84
    Quad Input/Output Fast Read instruction sequence. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85
    Quad Input/ Output Fast Read instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86
    Read OTP instruction and data-out sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87
    Write Enable instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88
    Write Disable instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89
    Page Program instruction sequence. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91
    Dual Input Fast Program instruction sequence. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 92
    Dual Input Extended Fast Program instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . 93
    Quad Input Fast Program instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94
    Quad Input Extended Fast Program instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . 95
    Program OTP instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 96
    How to permanently lock the OTP bytes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97
    Subsector Erase instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98
    Sector Erase instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 99
    Bulk Erase instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 99
    Read Status Register instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 102
    Write Status Register instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103
    Read Lock Register instruction and data-out sequence . . . . . . . . . . . . . . . . . . . . . . . . . . 104
    Write to Lock Register instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105
    Read Flag Status Register instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106
    Clear Flag Status Register instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107
    Read NV Configuration Register instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . 107
    Write NV Configuration Register instruction sequence. . . . . . . . . . . . . . . . . . . . . . . . . . . 108
    Read Volatile Configuration Register instruction sequence . . . . . . . . . . . . . . . . . . . . . . . 109
    Write Volatile Configuration Register instruction sequence . . . . . . . . . . . . . . . . . . . . . . . 110
    Read Volatile Enhanced Configuration Register instruction sequence. . . . . . . . . . . . . . . 110
    Write Volatile Enhanced Configuration Register instruction sequence. . . . . . . . . . . . . . . 111
    Deep Power-down instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112
    Release from Deep Power-down instruction sequence . . . . . . . . . . . . . . . . . . . . . . . . . . 113
    Multiple I/O Read Identification instruction and data-out sequence DIO-SPI . . . . . . . . . . 115
    Dual Command Fast Read instruction and data-out sequence DIO-SPI . . . . . . . . . . . . . 116
    Read OTP instruction and data-out sequence DIO-SPI . . . . . . . . . . . . . . . . . . . . . . . . . . 117
    Write Enable instruction sequence DIO-SPI . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117
    Write Disable instruction sequence DIO-SPI . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 118
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