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    STM8S105C4B3 参数 Datasheet PDF下载

    STM8S105C4B3图片预览
    型号： STM8S105C4B3
    PDF下载： 下载PDF文件 查看货源
    内容描述： 接入线路， 16兆赫STM8S 8位MCU ，最多32 KB闪存，集成的EEPROM ， 10位ADC ，定时器， UART ， SPI ， I²C [Access line, 16 MHz STM8S 8-bit MCU, up to 32 Kbytes Flash, integrated EEPROM,10-bit ADC, timers, UART, SPI, I²C]
    分类和应用： 闪存可编程只读存储器电动程控只读存储器电可擦编程只读存储器
    文件页数/大小： 127 页 / 1323 K
    品牌： STMICROELECTRONICS [ STMICROELECTRONICS ]
     浏览型号STM8S105C4B3的Datasheet PDF文件第90页浏览型号STM8S105C4B3的Datasheet PDF文件第91页浏览型号STM8S105C4B3的Datasheet PDF文件第92页浏览型号STM8S105C4B3的Datasheet PDF文件第93页浏览型号STM8S105C4B3的Datasheet PDF文件第95页浏览型号STM8S105C4B3的Datasheet PDF文件第96页浏览型号STM8S105C4B3的Datasheet PDF文件第97页浏览型号STM8S105C4B3的Datasheet PDF文件第98页  
    Electrical characteristics
    Table 43: SPI characteristics
    Symbol
    f
    SCK
    1
    t
    c(SCK)
    Parameter
    SPI clock
    frequency
    Conditions
    Master mode
    Slave mode
    t
    r(SCK)
    t
    f(SCK)
    t
    su(NSS)
    (1)
    STM8S105xx
    Min
    0
    0
    Max
    8
    6
    25
    Unit
    MHz
    SPI clock rise
    and fall time
    Capacitive load: C = 30 pF
    ns
    NSS setup time Slave mode
    4x
    t
    MASTER
    70
    t
    SCK
    /2 -
    15
    t
    SCK
    /2 +
    15
    ns
    t
    h(NSS)
    (1)
    NSS hold time
    SCK high and
    low time
    Slave mode
    Master mode
    ns
    t
    w(SCKH)
    t
    w(SCKL)
    t
    su(MI)
    t
    su(SI)
    (1)
    (1)
    ns
    (1)
    (1)
    Data input
    setup time
    Data input
    setup time
    Master mode
    5
    ns
    Slave mode
    5
    ns
    t
    h(MI)
    t
    h(SI)
    (1)
    (1)
    Data input hold
    time
    Data input hold
    time
    Master mode
    7
    ns
    Slave mode
    10
    ns
    t
    a(SO)
    (1) (2)
    Data output
    access time
    Data output
    disable time
    Data output
    valid time
    Slave mode
    3x
    t
    MASTER
    25
    ns
    t
    dis(SO)
    (1) (3)
    Slave mode
    ns
    t
    v(SO)
    (1)
    Slave mode
    (after enable edge)
    Master mode
    (after enable edge)
    73
    ns
    t
    v(MO)
    (1)
    Data output
    valid time
    36
    ns
    94/127
    DocID14771 Rev 9

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