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CY7C4801-25AC 参数 Datasheet PDF下载

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型号: CY7C4801-25AC
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内容描述: 五百一十二分之二百五十六/ 1K / 2K / 4K / 8K ×9 ×2双同步FIFO的 [256/512/1K/2K/4K/8K x9 x2 Double Sync FIFOs]
分类和应用: 存储内存集成电路先进先出芯片时钟
文件页数/大小: 23 页 / 286 K
品牌: CYPRESS [ CYPRESS SEMICONDUCTOR ]
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CY7C4801/4811/4821
CY7C4831/4841/4851
开关波形
写周期时序
t
CLKH
WCLKA ( WCLKB )
t
DS
DA
0
DA
8
( DB
0
DB
8
)
t
ENS
WENA1
(WENB1)
WENA2(WENB2)
(如适用)
FFA ( FFB )
t
SKEW1
[10]
RCLKA ( RCLKB )
RENA1,RENB2
( RENB1 , RENB2 )
48X1–6
t
CLK
t
CLKL
t
DH
t
ENH
无操作
无操作
t
WFF
t
WFF
读周期时序
t
CLKH
RCLKA ( RCLKB )
t
ENS
RENA1,RENA2
(RENB1,RENB2)
t
REF
EFA ( EFB )
t
A
QA
0
QA
8
( QB
0
QB
8
)
t
ENH
t
CLK
t
CLKL
无操作
t
REF
有效数据
t
OLZ
t
OE
t
OHZ
OEA ( OEB )
t
SKEW1
WCLKA , WCLKB
WENA1(WENB1)
[11]
WENA2(WENB2)
48X1–7
注意事项:
10. t
SKEW1
是一个上升( RCLKA , RCLKB )边缘与上升( WCLKA , WCLKB )边缘之间的最小时间保证(FFA , FFB )将在当前时钟变为高电平
周期。如果( RCLKA , RCLKB )的上升沿和( WCLKA , WCLKB )的上升沿之间的时间小于吨
SKEW1
,那么( FFA , FFB )可能不会改变状态,直到
明年( WCLKA , WCLKB )上升沿。
11. t
SKEW1
是一个上升( WCLKA , WCLKB )边缘与上升( RCLKA , RCLKB )边缘之间的最小时间保证(EFA , EFB)将在当前时钟变为高电平
周期。它( WCLKA , WCLKB )的上升沿和RCLK的上升沿之间的时间小于吨
SKEW1
话(EFA , EFB)可以不改变状态,直到下一
( RCLKA , RCLKB )上升沿。
文件编号: 38-06005牧师**
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