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    HYB18T512800AF-3S 参数 Datasheet PDF下载

    HYB18T512800AF-3S图片预览
    型号： HYB18T512800AF-3S
    PDF下载： 下载PDF文件 查看货源
    内容描述： 512兆位双数据速率 - 双SDRAM的 [512-Mbit Double-Data-Rate-Two SDRAM]
    分类和应用： 存储内存集成电路动态存储器双倍数据速率
    文件页数/大小： 58 页 / 3023 K
    品牌： QIMONDA [ QIMONDA AG ]
     浏览型号HYB18T512800AF-3S的Datasheet PDF文件第3页浏览型号HYB18T512800AF-3S的Datasheet PDF文件第4页浏览型号HYB18T512800AF-3S的Datasheet PDF文件第5页浏览型号HYB18T512800AF-3S的Datasheet PDF文件第6页浏览型号HYB18T512800AF-3S的Datasheet PDF文件第8页浏览型号HYB18T512800AF-3S的Datasheet PDF文件第9页浏览型号HYB18T512800AF-3S的Datasheet PDF文件第10页浏览型号HYB18T512800AF-3S的Datasheet PDF文件第11页  
    互联网数据表
    HYB18T512[40/80/16]0AF(L)–[3/3S/3.7/5]
    512 - Mbit的DDR2 SDRAM
    2
    2.1
    引脚配置
    引脚配置TFBGA - 60 TFBGA -84
    本章包括引脚配置。
    一个DDR2 SDRAM的引脚配置中列出的功能
    表6 。
    在Pin ＃和缓冲器类型中使用的缩写
    列中的说明
    表7
    和
    表8
    分别。引脚编号为FBGA封装的描述
    图1
    为
    ×
    4,
    图2
    为
    ×
    8
    科幻gure 3
    为
    ×
    16.
    表6
    DDR2 SDRAM的引脚配置
    针＃
    名字
    针
    TYPE
    I
    I
    I
    I
    I
    I
    卜FF器
    TYPE
    SSTL
    SSTL
    SSTL
    SSTL
    SSTL
    SSTL
    时钟使能
    时钟信号CK，互补时钟信号CK的
    注：请参阅X4 / X8组织功能描述
    时钟使能
    注：请参阅X4 / X8组织功能描述
    行地址选通（RAS） ，列地址选通（CAS） ，写
    使能（ WE）
    芯片选择
    行地址选通（RAS） ，列地址选通（CAS） ，写
    使能（ WE）
    芯片选择
    银行地址总线1 ： 0
    功能
    时钟信号
    ×4/×8
    组织
    E8
    F8
    F2
    J8
    K8
    K2
    CK
    CK
    CKE
    CK
    CK
    CKE
    时钟信号CK，互补时钟信号CK的
    时钟信号
    ×16
    组织
    控制信号的
    ×4/×8
    组织
    F7
    G7
    F3
    G8
    K7
    L7
    K3
    L8
    G2
    G3
    RAS
    CAS
    WE
    CS
    RAS
    CAS
    WE
    CS
    BA0
    BA1
    I
    I
    I
    I
    I
    I
    I
    I
    I
    I
    SSTL
    SSTL
    SSTL
    SSTL
    SSTL
    SSTL
    SSTL
    SSTL
    SSTL
    SSTL
    控制信号的
    ×16
    组织
    地址信号
    ×4/×8
    组织
    牧师1.71 ， 2007-01
    03062006-CPCN-4867
    7

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